Синтез дискретных устройств

Размещено на http://www.allbest.ru/

Министерство образования Республики Беларусь

Учреждение образования

"Белорусский государственный университет транспорта"

Кафедра "Автоматика и телемеханика"

Курсовой проект

Синтез дискретных устройств

Выполнил:

студент группы ЭТ-32

Москаленко С.Ю.

Проверил:

преподаватель Шкуринов В.В

Гомель 2015

Аннотация

Данный курсовой проект по дисциплине "Теория дискретных устройств" посвящен разработке принципиальной схемы дискретного устройства с заданной структурной схемой. При выполнении курсового проекта получены необходимые навыки по инженерному проектированию дискретных устройств, по разработке схем дискретных устройств и выборе методики расчета, произведена оценка различных вариантов схем.

В данном курсовом проекте разработаны и описаны такие отдельные узлы и блоки дискретного устройства, как: генератор импульсов, счетчик, шифратор, дешифратор, параллельный регистр, преобразователь кодов, сумматор, мультиплексор и параллельно-последовательный регистр. Все схемы в курсовом проекте в соответствии с заданием реализованы в базисе "ИЛИ-НЕ".

Содержание

Введение

1. Синтез основных узлов дискретного устройства

1.1 Генератор прямоугольных импульсов

1.2 Синтез параллельно-последовательного счетчика

1.3 Синтез демультиплексора

1.4 Синтез регистра

1.5 Синтез ПЛМ

2. Обоснование выбора и описание функциональных и электрических схем проектируемых узлов и блоков ДУ

Заключение

Список использованных источников

Приложения



Введение

На современном этапе развития научно-технического прогресса повсеместно, во всех отраслях промышленности идет автоматизация производства. Автоматизация производственных процессов имеет огромное значение для народного хозяйства. Автоматы, или электрические и электронные устройства, построенные на разнообразнейших реле и дискретных электронных элементах, берут на себя самую тяжелую и рутинную работу, которую раньше выполнял человек. Автомат имеет огромные преимущества перед человеком. Он никогда не устанет, он никогда не упустит даже самых мельчайших деталей. Автомат всегда выполняет строго заранее определенные действия, и не отходит от них ни на шаг. Исключение составляют лишь редкие случаи - ошибки в программе работы какого-либо устройства или воздействия на него внешних помех. Поэтому все большее внимание уделяется методам разработки безопасных, и надежных устройств.

Цифровое устройство может быть спроектировано правильно только при наличии точных описаний ИС. Более того, спроектированное устройство должно содержать наименьшее число ИС для снижения его стоимости. Этого можно требовать от разработчика только при предоставлении ему полного их описания. Задание ИС с помощью таблиц истинности не только громоздко, но и, являясь первой ступенью синтеза любого цифрового устройства, не содержит описания его работы в минимальной форме, необходимой для облегчения анализа возможностей ИС для конкретных приложений.

ИС нашли широкое применение в вычислительных машинах и комплексах, в электронных устройствах автоматики, аппаратуре связи и передачи данных, современной радиоэлектронной аппаратуре бытового, промышленного и специального назначения; в товарах культурно-бытового назначения (телевизорах, магнитофонах, радиоприемниках, кино, фотоаппаратуре, электронных часах), в транспортной электронике, сельском хозяйстве, медицине и многих других областях.

В том числе огромное количество электронных дискретных устройств, применяются сейчас на железных дорогах всего мира. Не составляет исключения и наша республика. Без современных автоматизированных систем управления невозможно существование железной дороги такой, как мы видим ее сейчас. Устройства автоматизации повышают безопасность проезда поездов, увеличивают пропускную способность железных дорог, увеличивают надежность железной дороги в целом. Поэтому особенно важно развивать эту отрасль.

Дискретные устройства, не учитывая остальные параметры, разделяются на 2 группы: программируемые и с жесткой логикой. Каждая группа имеет свои преимущества. Устройства с жесткой логикой намного превосходят программируемые устройства по быстродействию, однако, если будет необходимо поменять алгоритм работы устройства, устройство с жесткой логикой нужно будет создавать заново, тогда как в программируемом устройстве необходимо лишь заменить микросхему, в которой записана программа или алгоритм работы устройства.

Целью данного курсового проекта является рассмотрение ряда базовых вопросов построения логических устройств с жесткой логикой на базе современных интегральных схем. Развить у студента инженерное мышление т.к. в настоящее время инженеру необходимо знать не только принципы работы дискретных устройств, но знать принципы построения таких устройств. Это необходимо для того, чтобы уметь находить неисправности, знать способы реализации таких устройств в имеющемся элементном базисе.

1. Синтез основных узлов дискретного устройства

1.1 Генератор прямоугольных импульсов

Генератор прямоугольных импульсов (рисунок 1) собран на логических элементах ИЛИ-НЕ.

В данной схеме резистор R1 используется для начального запуска генератора. Напряжение на выходе генератора имеет вид последовательности прямоугольных импульсов, которые в свою очередь воздействуют на другие составляющие части дискретного устройства.

Частота генерации задается с высокой точностью с помощью кварцевого резонатора ZQ.

Для стабилизации взят кварцевый резонатор на 1000 кГц РГ06.

В соответствии с выходной частотой возьмём R1 = 1 кОм.

Рисунок 1 - Схема генератора прямоугольных импульсов

Временная диаграмма имеет следующий вид:

Рисунок 1.2-Временная диаграмма работы генератора прямоугольных

Т=1/f=1/1000000=1 мкс



1.2 Синтез параллельно-последовательного счетчика

Счётчики импульсов - это дискретные устройства с памятью, осуществляющие подсчёт числа поступающих входных импульсов и хранящих подсчитанное число в виде двоичного кода.

По заданию необходимо разработать суммирующий двоично-десятичный счетчик импульсов с коэффициентом счета К=21 и параллельно-последовательный переносом. Внутри каждой декады будет производиться параллельный, а между декадами - последовательный перенос. Информация на выходе счетчика представляется в коде 8421. Для синтеза схемы применяются D-триггеры [стр] и логические элементы базиса "ИЛИ-НЕ". Минимизация функций алгебры логики производится с помощью карт Карно и Квайна-Мак-Класки.

Для данного счетчика используется m = 4 триггера для счета от 0 до 9 и n = 2 триггер для второго разряда десятичного числа:

2m-1102m, откуда m = 4;

2n-132n , откуда n = 2.

Составим отдельно таблицы истинности для младшего и старшего разрядов.

Таблица 1 Таблица истинности младших разрядов счетчика на D-триггерах

Номер входного импульса	Текущие состояния триггеров	Последующие состояния триггеров	Функции возбуждения
	Q4	Q3	Q2	Q1	Q4	Q3	Q2	Q1	D4	D3	D2	D1
0	0	0	0	0	0	0	0	1	0	0	0	1
1	0	0	0	1	0	0	1	0	0	0	1	0
2	0	0	1	0	0	0	1	1	0	0	1	1
3	0	0	1	1	0	1	0	0	0	1	0	0
4	0	1	0	0	0	1	0	1	0	1	0	1
5	0	1	0	1	0	1	1	0	0	1	1	0
6	0	1	1	0	0	1	1	1	0	1	1	1
7	0	1	1	1	1	0	0	0	1	0	0	0
8	1	0	0	0	1	0	0	1	1	0	0	1
9	1	0	0	1	0	0	0	0	0	0	0	0

Таблица 2 Таблица истинности старших разрядов счетчика

Номер входного импульса	Текущие состояния триггеров	Последующие состояния триггеров	Функции возбуждения
	Q5	Q6	Q5	Q6	D5	D6
0	0	0	0	1	0	1
1	0	1	1	0	1	0
2	1	0	0	0	0	0

Минимизируем функции воздействий младших разрядов на D-входы триггеров с помощью карт Карно.

D3 D3= Q3Q3Q2 Q1;

Рисунок 2 - Минимизация функции D3 методом карт Карно

D2 D2=Q2Q4;

Рисунок 3 - Минимизация функции D2 методом карт Карно



D1 D1= ;

Рисунок 4 - Минимизация функции D1 методом карт Карно

Упростим функцию D4 методом Квайна-Мак-Класки.

Суть метода в следующем. Члены СДНФ записываются в виде их двоичных номеров. Все номера разбиваются на группы по числу единиц в них. При этом в i-ю группу входят все номера, которые имеют в своем двоичном коде количество единиц равное i. Затем выполняется попарное сравнение членов соседних по номеру групп (т.е. реализуется закон склеивания по отношению к кодовым комбинациям), так как только члены этих групп отличаются лишь в одном разряде.

При образовании членов с рангом (числом единиц) выше нулевого в разряды, соответствующие исключенным переменным, пишется знак тире (прочерк).

1-й этап. Составим таблицу не полностью заданной функции.

Таблица 3 - Не полностью заданная ФАЛ четырех переменных

№ набора	Исходный код	f
	Q4	Q3	Q2	Q1	D4
0	0	0	0	0	0
1	0	0	0	1	0
2	0	0	1	0	0
3	0	0	1	1	0
4	0	1	0	0	0
5	0	1	0	1	0
6	0	1	1	0	0
7	0	1	1	1	1
8	1	0	0	0	1
9	1	0	0	1	0

Анализируя данные таблицы, определяем, что в ней имеется 2 разрешенных (7,8) наборов и 8 запрещенных (0,1,2,3,4,5,6,9). Остальные наборы являются неиспользуемыми.

2-й этап. Перепишем данную функцию, дополним её неиспользуемыми состояниями заменив их на разрешённые, подставив вместо ее инверсных аргументов "0", а вместо не инверсных - "1" и получим

D4=Q4Q3Q2Q1Q4Q2Q4Q2Q1Q4Q3Q1Q4Q3Q2 Q4Q3Q2Q1 Q4Q3

D4=01111000101010111101111011111100

3-й этап. Разобьем номера функции на группы по числу единиц.

После разбиения на группы выполняется сравнение соседних групп. При сравнении отыскиваются те пары кодов, которые отличаются одним разрядом на соответствующих позициях. Тот разряд, которым кодовые комбинации различаются, заменяется прочерком, а полученная комбинация записывается в ту из сравниваемых групп, которая имела меньший номер (таблица 4.4). После первого сравнения полученные члены разложения первого ранга также сравниваются между собой



Далее, строится таблица поглощений в которую входят все исходные и неиспользуемые коды (в столбцах) и все коды после последнего склеивания (в строках).

Таблица 5 - Таблица поглощений

Теперь составим таблицу поглощений тока с разрешёнными кодами

Таблица 6 - Таблица склеивания соседних групп

Номер группы	Члены группы	Члены разложения первого ранга	Члены разложения второго ранга
1	1000	10-0,1-00	1- -0
2	1010,1100	1-10,101-,110-,11-0	1-1-,11- -
3	0111,1011,1101,1110	-111,1-11,11-1,111-	-111
4	1111

Таким образом, запишем результат минимизации

D4=Q4Q3Q2Q1.

Запишем функции воздействий старших разрядов на D-входы триггеров, из таблицы видно, что каждому D-входу соответствует тока 1 состояние.

D1=Q2, D2=.



Приведем все состояние D-входов к базису "или-не":

Младшие разряды

D4=Q4Q3Q2Q1=;

D3= Q3Q3Q2 Q1=;

D2=Q2Q1=;

D1=;

Старшие разряды

D1=Q2=;

D2==;



Рисунок 7 - временная диаграмма поясняющая работу счетчика

1.3 Синтез демультиплексора

Деультиплексор - комбинационное дискретное устройство, имеющее в общем случае вход данных D, адресные входы Ak, вход синхронизации и выходы Qn. Количество выходов и адресных входов связано соотношением n = 2k 1.

В процессе функционирования демультиплексор подключает вход данных к тому из выходов, номер которого задан на адресных входах при наличии сигнала синхронизации. Демультиплексоры также бывают и асинхронными. В таком случае у них отсутствует вход С.

Необходимо построить схему асинхронного демультиплексора на пять выходов данных в базисе "ИЛИ-НЕ". В этом случае необходимы три адресных входа, а функционирование демультиплексора определяется в соответствии 3.1.

Поскольку при трех адресных входах можно коммутировать данные на восемь выходов по формуле n = 2k , а в данном случае используются лишь пять выходов, то их функции будут частично заданы и мы упростим их с помощью карт Карно.

Таблица 8 - Таблица истинности мультиплексора

Сигналы управления	Входы	Выходы
S1	S2	S3	A1	A2	A3	A4	A5	Y
0	0	0	D	0	0	0	0	D1
1	0	0	0	D	0	0	0	D2
1	1	0	0	0	D	0	0	D3
1	1	1	0	0	0	D	0	D4
0	1	1	0	0	0	0	D	D5

Упрощение функций выводов мультиплексора

Выходные функции с учетом входа синхронизации будут иметь вид:

Преобразуем полученные функции к виду, удобному для построения в базисе "ИЛИ-НЕ".



Построим схему мультиплексора.

Рисунок 8 - Временная диаграмма демультиплексора

1.4 Синтез регистра

Конструктивно регистры представляют собой наборы триггеров со схемами управления. Используются параллельно-последовательные регистры для хранения данных и преобразования двоичной информации из параллельной формы в последовательную.

Ввод и вывод информации для таких регистров осуществляется в параллельной и последовательной форме.

Все разряды двоичного числа подаются одновременно на входы регистра. На вход С1 подается сигнал управления записью информации, а на вход C2 - сигнал управления считыванием информации.

Правила работы регистра для n-го такта работы представлены в таблице 5.

Таблица 10 Таблица истинности параллельного регистра на D-триггерах

Сигналы управления работой регистра	Выходные сигналы
C1n	C2n	Qin
0	0	Q1n=Q1n-1; Q2n=Q2n-1; Q3n=Q3n-1=yn
0	1	Q1n=0; Q2n=Q1n-1; Q3n=Q2n-1=yn
1	0	Q1n=x1n; Q2n=x2n; Q3n=x3n=yn

Комбинация C1n = C2n = 1 является запрещенной, т. е. нельзя одновременно записывать и считывать информацию [1, c. 66-67].

Необходимо построить параллельно-последовательный регистр на 6 разрядов.

Рисунок 9 - Параллельно-последовательный регистр



Рисунок 10 - Временная диаграмма поясняющая работы регистра

1.5 Синтез ПЛМ

Реализуем схему преобразователя кодов на ПЛМ.

На основе таблицы 11 и с учетом свойства независимости входов и выходов можно найти функции алгебры логики выходов матриц М1 и М2.

Таблица 11 - ТИ преобразователя кодов на ПЛМ

Десятичное число	Исходный код (входы)	Получаемый код (выходы)	Выходы M
	X6	X5	X4	X3	X2	X1	Y5	Y4	Y3	Y2	Y1	Fi
13	1	0	1	0	0	1	0	1	1	0	1	F1
14	1	0	1	1	0	0	0	1	1	1	0	F2
15	1	0	1	1	1	1	0	1	1	1	1	F3
16	1	1	0	0	1	0	1	0	0	0	0	F4
17	1	1	0	1	0	1	1	0	0	0	1	F5



Функции на выходе матрицы М1:

На выходе матрицы М2:

В соответствии с полученными уравнениями осуществляется программирование ПЛМ. Узлы матрицы, в которых необходимо сохранить транзисторы, отмечены на рисунке точками.



Рисунок 12 - Точечное начертание ПК на ПЛМ

Рисунок 13 - Реализация ПК на ПЛМ

2. Обоснование выбора и описание функциональных и электрических схем проектируемых узлов и блоков ДУ

Рисунок 1 - Структурная схема ДУ

По заданной схеме демультиплексор имеет 5 выходов, а как известно из условия работы у него присутствует адресные входы, в данном случаи нам хватит 3 входов, и 1 информационный вход мы возьмем с делителя частоты.

Генератор прямоугольных импульсов генерирует колебания прямоугольной формы с заданным периодом, следовательно, на выходе будет постоянно одно состояние.

На параллельно-последовательный счётчик импульсов поступают импульсы, однако он должен считать только до 21,а потом сбрасываться и начинать считать заново, поэтому для подсчёта количества этих импульсов и сохранения потребуется шесть разрядов для десятков(10) и единиц (1001), а, следовательно, и 6 двухразрядных триггера, которые будут выдавать информацию в параллельном виде.

Так как со счетчика выходит 6 разрядов нам потребуется преобразователь кодов на 6 входов, а как известно из условия работы он преобразует (переводит) из одного кода (3а+2) в другой код (8421). По таблице истинности мы определили что на выходе получается 5 разрядное число, следовательно, и 5 выходов.

Так же с генератора импульсов подаются импульсы и на делитель частоты, который по своим свойствам уменьшает количество импульсов на определенное число (по заданию 11), и на выходе мы получаем 2 импульса но уже с большей длительностью, для деления чистоты мы будем использовать 4 триггера, так как каждый триггер делит частоту на 2, и предусмотрим сброс на 11 такте.

Так как на сумматор поступает пять состояний пришедших из преобразователя кодов и демультиплексора, то исходя из работы сумматора мы будет находить сумму состояний между ПК и демультиплексора. Следовательно на выходе вычитающего устройства будет шесть состояний из за переполнения разряда у нас присутствует перенос в следующий разряд.

Для того чтобы получить информацию из параллельной формы в последовательную мы используем параллельно-последовательный регистр. Будем использовать 6 разрядов регистра, с той целью, что с выхода сумматора у нас 6 разрядов.

Работа дискретного устройства заключается в следующем:

Генератор тактовых импульсов, представляющий собой кварцевый генератор, вырабатывающий тактовые импульсы с частотой f = 1000 кГц.

Далее импульсы поступают на суммирующий счетчик с коэффициентом счёта 21,выполненного на D-триггерах. Счетчик считает импульсы от 0 до 21, затем после того, как на всех выходах шести триггеров появляется комбинация 10 0001, что соответствует цифре 21 в десятичном эквиваленте у параллельно-последовательного счетчика, счётчик обнуляется и устанавливается в состояние 00 0000, тем самым запускается новый цикл подсчета импульсов.

В момент времени, когда импульсы поступают на счётчик они также подаются и на ПК, который преобразует полученные данные из одного кода в другой.

В то время когда счетчик подсчитывает импульсы с ГИ подаются импульсы на делитель частоты, который уменьшает частоту импульсов. После чего с делителя частоты импульсы подаются на демультиплексор.

Демультиплексор комбинационное дискретное устройство, имеющее в общем случае вход данных D, адресные входы Ak, выходы Qn.

В процессе функционирования демультиплексор подключает вход данных к тому из выходов, номер которого задан на адресных входах.

После чего с ПК и демултьтиплексора импульсы подаются сумматор, где импульсы слаживаться, и после чего подаются на регистр.

Регистр позволяет преобразовать информацию с параллельного вида в последовательный, после чего подаётся на выход.



Заключение

В результате выполнения данного курсового проекта было разработано дискретное устройство (ДУ), которое имеет следующую структуру:

- генератор прямоугольных импульсов;

- преобразователь кодов;

- счетчик с параллельно-последовательным переносом с коэффициентом счёта равным 21;

- параллельно-последовательный регистр;

- устройство суммирования;

- демультиплексор;

-делитель частоты;

Работа каждого блока дискретного устройства была пояснена либо импульсно-временной диаграммой, либо диаграммой состояний. Так же была разработана принципиальная схема данного дискретного устройства, и отдельным пунктом была описана его работа. В качестве элементов памяти были использованы D-триггеры. Дискретное устройство реализовано в базисе "ИЛИ-НЕ".

При выполнении данного курсового проекта также была изучена методика минимизации функций алгебры логики несколькими методами: такими как метод карт Карно и метод Квайна-Мак-Класки.



Список использованных источников

1 Бочков К.А., Березняцкий Ю.Ф. Анализ функциональной структуры и синтез дискретных устройств: Лабораторный практикум по дисциплине "Теория дискретных устройств". Ч.I-III. / Белорус. гос. ун-т трансп. Гомель: БелГУТ, 2001.

2 Березняцкий Ю.Ф. Задание и минимизация функций алгебры логики: Пособие для практических занятий по дисциплине "Теория дискретных устройств". - Гомель: БелГУТ, 2004. - 44 с.

3 Мулярчик С.Г. Интегральная схемотехника (функционально-логический уровень). - Мн: Изд-во БГУ, 1983. - 189 с.: ил.

4 Интегральные микросхемы: Справочник / Б.В. Тарабрин, Л.Ф. Лунин, Ю.Н. Смирнов и др.; - М.: Радио и связь, 1983. - 528 с.: ил.

5 Автоматика, телемеханика и связь на транспорте: Пособие по оформлению дипломных проектов / Бочков К.А., Серенков А.Г., Кондрачук В.Ф., Харлап С.Н. Гомель: БелГУТ, 2002. 70 с.



Приложения

Приложение А - Разработка и описание элементов управления (сброса/установки) схемой

Схему сброса/установки рассмотрим на примере счётчика импульсов (рисунок В.1):

Она имеет два положения:

- нормальное, когда на вход 2 счётчика подается питание через резистор(логическая "1");

- состояние "сброса", когда нажимается кнопка и на вход 2 счётчика подается состояние логического "0".

Конденсатор служит для стабилизации схемы.

Схема сброса/установки показана на рисунке В.2.

Рисунок А.1 - Схема счётчика импульсов с применением в ней схемы сброса/установки



Рисунок А.2 - Схема сброса/установки



Приложение Б - Выбор микросхем

4 элемента 2ИЛИ-НЕ

Таблица Б.1 Назначение выводов ИМС К555ЛЕ1

Номер вывода	Назначение	Вывод	Назначение
1	Выход элемента 1	8	Вход элемента 5
2	Вход элемента 1	9	Вход элемента 6
3	Вход элемента 2	10	Выход элемента 3
4	Выход элемент 2	11	Вход элемента 7
5	Вход элемента 3	12	Вход элемента 8
6	Вход элемента 4	13	Выход элемента 4
7	Общий	14	+Uпит

Таблица Б.2 - Параметры ИМС К555ЛЕ1(2ИЛИ - НЕ)

T,°C	Icc, mA	TpHLmax,нс	TpLHmax,нс	Тип корпуса
0…+70	8	20	24	DIP14

3 элемента 3ИЛИ-НЕ

Таблица Б.3 - Назначение выводов ИМС К555ЛЕ4

Номер вывода	Назначение	Вывод	Назначение
1	Вход элемента 1	8	Выход элемента 3
2	Вход элемента 2	9	Вход элемента 7
3	Вход элемента 4	10	Вход элемента 8
4	Вход элемента 5	11	Вход элемента 9
5	Вход элемента 6	12	Выход элемента 1
6	Выход элемент 2	13	Вход элемента 3
7	Общий	14	+Uпит

Таблица Б.4 - Параметры ИМС 555ЛЕ4(3ИЛИ - НЕ)

T,°C	Icc, mA	TpHLmax,нс	TpLHmax,нс	Тип корпуса
0…+70	8	19	25	DIP14

2 элемента 4ИЛИ-НЕ

Таблица Б.5 - Назначение выводов ИМС К155ЛЕ3

Номер вывода	Назначение	Вывод	Назначение
1	Вход элемента 1	8	Выход элемента 2
2	Вход элемента 2	9	Вход элемента 5
3	Вход элемента Е1	10	Вход элемента 6
4	Вход элемента 3	11	Вход элемента Е1
5	Вход элемента 4	12	Вход элемента 7
6	Выход элемент 1	13	Вход элемента 8
7	Общий	14	+Uпит



Таблица Б.6 - Параметры ИМС К155ЛЕ3(4ИЛИ-НЕ )

T,°C	Icc, mA	TpHLmax,нс	TpLHmax,нс	Тип корпуса
0…+70	19	15	22	DIP14

1 элемент 8ИЛИ-НЕ

Таблица Б.7 - Назначение выводов ИМС К133ЛМ1

Номер вывода	Назначение	Вывод	Назначение
1	Вход элемента 1	8	Выход элемента 1
2	Вход элемента 2	9	Вход элемента 6
3	Вход элемента 3	10	Вход элемента 7
4	Вход элемента 4	11	Вход элемента 8
5	Вход элемента 5
7	Общий	14	+Uпит

Таблица Б.8 - Параметры ИМС К133ЛМ1 (8ИЛИ - НЕ)

T,°C	Icc, mA	TpHLmax,нс	TpLHmax,нс	Тип корпуса
0…+70	19	15	22	DIP14

2 независимых D-триггера



Таблица Б.9 - Назначение выводов ИМС К1533ТМ2

Вывод	Назначение	Вывод	Назначение
1	Вход R	8	Инверсный выход
2	Вход D	9	Прямой выход
3	Вход С	10	Вход S
4	Вход S	11	Вход C
5	Прямой выход	12	Вход D
6	Инверсный выход	13	Вход R
7	Общий	14	+Uпит

Таблица Б.10 - Параметры ИМС К1533ТМ2

S	R	C	D	Q
1	1	0	X	Qn-1
1	1	0>1	0	0
1	1	0>1	1	1
1	1	1	x	Qn-1
0	1	X	x	1
1	0	X	x	0
0	0	X	x	X

Таблица Б.11 - Таблица истинности D-триггера

Напряжение питания номинальное В	5
Потребляемый ток мА	8
Задержка при переключении, нс	40
Диапазон температур, °С	-10...+70

Таблица Б.12 - Назначение выводов ИМС К555 ИМ5

Номер вывода	Назначение	Вывод	Назначение
1	Вход элемента A1	12	Выход элемента P1
2	Выход элемента S1	14	Выход элемента P2
3	Вход элемента B1	6	Выход элемент S2
4	Вход элемента B2	7	Вход элемента A2
5	Вход элемента P1	8	Вход элемента P3



2 полных независимых сумматора

Таблица Б.13 - Параметры ИМС К555 ИМ5

Параметры	54LS/74LS (533,555)
Выходной ток лог. 1, мА	0.4
Выходной ток лог. 0, мА	4/8
Входной ток лог. 0, мА	1.2
Входной ток лог. 1, мкА	60
Ток потребления, мА	-10-17
Задержки распространения (нс)
= L-->H	-15-23
= H-->L	-15-23

Размещено на Allbest.ru